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李`R 
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XC2C256-7FT256I，Xilinx原装
制造商
Xilinx Inc.
制造商零件编号
描述 IC CPLD 256MC 6.7NS 256BGA
XC2C256-7FT256I特征
•为1.8V系统优化
-业界快的低功耗CPLD
从32到512个宏单元密度
•业界的0.18微米CMOS CPLD
有效逻辑综合的优化体系结构
多电压I/O操作- 1.5V到3.3V
•先进的系统特性
快的系统编程
·1.8v ISP使用IEEE 1532（JTAG）接口
-飞行重构（OTF）
- IEEE1149.1 JTAG边界扫描测试
-可选的Schmitt触发器输入（每针）
-所有设备上的多个I/O银行
卓越的低功耗管理
·DataGATE的外部信号控制
-灵活的时钟模式
·可选dualedge触发寄存器
·时钟分频器（÷2,4,6,8,10,12,14,16）
·CoolCLOCK
-带有宏单元控制的全局信号选项
·多个全局时钟，每个相选择
宏
多重全局输出使
·全局设置/重设
-丰富的产品术语时钟，输出启用和
设置/复位
-有效的控制项时钟，输出启用和
设置/重置每个宏单元并共享
功能块
-设计安全
-开路漏输出选项有线或LED
开车
可选的总线，三态或弱上拉的选择
输入输出引脚
-在未使用的I/O上可选的可配置的理由
混合I/O电压兼容1.5V，1.8v，
2.5V和3.3V逻辑电平的所有部分
- sstl2_1，sstl3_1，和hstl_1 128
XC2C256-7FT256I宏单元和密集器件
-热插拔
•PLA架构
-优越的引脚保留
100%产品期限路由在功能块
•广泛的包装可用性，包括细间距：
芯片级封装（BGA）BGA、细线BGA，
TQFP，PQFP，VQFP，和QFN封装
- PB提供所有包
•使用赛灵思和工业设计输入/验证
标准的CAE工具
•软件支持所有密度使用Xilinx的
™WebPACK工具
•业界的非易失性0.18微米CMOS
XC2C256-7FT256I过程
-保证1000程序/擦除周期
-保证20年数据保留
家族概况
Xilinx CoolRunner II CPLD™-提供高速度和
使用与CPLD / XL /十五CPLD家庭相关的缓解
随着XPLA3极低功率的通用性
单一CPLD中的家庭。这意味着完全相同。
部件可用于高速数据通信/
计算机系统和前沿便携式产品，
在系统编程中增加了好处。低
功耗与高速运行相结合
成为一个易于使用和成本效益的单一家庭。
时钟技术和其他节电功能
扩展用户功率预算。设计特点是
支持从Xilinx ISE®4.1i WebPACK工具。
更多细节可在进一步阅读中找到，
XC2C256-7FT256I体系结构描述
CoolRunner-II CPLD是一个高度统一的家庭快速、低
功率器件。底层架构是传统的
CPLD架构相结合的宏功能
与全局路由矩阵互连的块（FBS），
赛灵思互连矩阵（AIM）。FBS使用
一种可编程逻辑阵列（PLA）的配置
允许所有产品术语被路由和共享
对FB的宏。设计软件可以高效
综合并优化随后适合于
与使用率很高的人有联系。
设备资源。设计更改很容易
并由软件自动管理，它利用
100%路由的可编程逻辑阵列内
每个FB。这个非常强大的积木提供了
行业的引脚保留，在非常广泛的设计
条件.该体系结构更详细地说明
底层FBS的讨论、逻辑和互连。
设计软件自动管理这些设备。
资源，以便用户可以使用
完全没有这些知识的泛型构造
建筑的细节。更先进的用户可以利用
对这些细节要更透彻地了解
软件的选择及其结果。
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